Akcelerace šifry AES pomocí programovatelných hradlových polí
| dc.contributor.author | Smékal, David | |
| dc.contributor.author | Frolka, Jakub | |
| dc.coverage.issue | 3 | cs |
| dc.coverage.volume | 18 | cs |
| dc.date.accessioned | 2023-10-09T08:46:23Z | |
| dc.date.available | 2023-10-09T08:46:23Z | |
| dc.date.issued | 2016-06-30 | cs |
| dc.description.abstract | This article deals with encryption on Field Programmable Gate Array (FPGA). The first part of the article fuses on the analysis of the current state of implementation of asymmetric and symmetric ciphers. The next section describes the encryption algorithm AES and its own implementation using VHDL programming language. In the last part, the test results of our implementation to network card COMBO-80G, based on FPGA Xilinx Virtex-7 are shown. | en |
| dc.description.abstract | Článek se zabývá šifrováním na programovatelných hradlových polí FPGA (Field Programmable Gate Array). První část článku je zaměřena na analýzu současného stavu implementací asymetrických a symetrických šifer. V další části je popsán šifrovací algoritmus AES a jeho vlastní implementace pomocí programovacího jazyka VHDL. V poslední části, jsou uvedeny výsledky testování implementovaného algoritmu AES na kartě COMBO-80G, založené na FPGA firmy Xilinx řady Virtex-7. | cs |
| dc.format | text | cs |
| dc.format.extent | 76-82 | cs |
| dc.format.mimetype | application/pdf | en |
| dc.identifier.citation | Elektrorevue. 2016, vol. 18, č. 3, s. 76-82. ISSN 1213-1539 | cs |
| dc.identifier.issn | 1213-1539 | |
| dc.identifier.uri | http://hdl.handle.net/11012/214267 | |
| dc.language.iso | cs | cs |
| dc.publisher | International Society for Science and Engineering, o.s. | cs |
| dc.relation.ispartof | Elektrorevue | cs |
| dc.relation.uri | http://www.elektrorevue.cz/ | cs |
| dc.rights | (C) 2016 Elektrorevue | en |
| dc.rights.access | openAccess | en |
| dc.title | Akcelerace šifry AES pomocí programovatelných hradlových polí | cs |
| dc.title.alternative | Acceleration of AES by using FPGA | en |
| dc.type.driver | article | en |
| dc.type.status | Peer-reviewed | en |
| dc.type.version | publishedVersion | en |
| eprints.affiliatedInstitution.faculty | Fakulta elektrotechniky a komunikačních technologií | cs |
Files
Original bundle
1 - 1 of 1
Loading...
- Name:
- clanek_12_30.06.2016.pdf
- Size:
- 1.05 MB
- Format:
- Adobe Portable Document Format
- Description: