Prostředí pro návrh digitálních obvodů s využitím vlastního jazyka typu HLS
but.committee | doc. Ing. Tomáš Frýza, Ph.D. (předseda) prof. Ing. Miroslav Kasal, CSc. (místopředseda) Ing. Aleš Povalač, Ph.D. (člen) prof. Ing. Lubomír Grmela, CSc. (člen) Ing. Kamil Pítra, Ph.D. (člen) | cs |
but.defence | Student odpovídá na otázky oponenta. doc. Ing. Tomáš Frýza, Ph.D. Je možné generovat VHDL i Verilog kód? Student objasňuje že jen VHDL. Zkoušel jste takto generovaný kód implementovat do FPGA? Student vysvětluje že to z časových důvodů nešlo. | cs |
but.jazyk | čeština (Czech) | |
but.program | Elektronika a komunikační technologie | cs |
but.result | práce byla úspěšně obhájena | cs |
dc.contributor.advisor | Fujcik, Lukáš | cs |
dc.contributor.author | Pastušek, Václav | cs |
dc.contributor.referee | Dvořák, Vojtěch | cs |
dc.date.accessioned | 2022-06-15T07:54:33Z | |
dc.date.available | 2022-06-15T07:54:33Z | |
dc.date.created | 2022 | cs |
dc.description.abstract | V dnešní době existuje spoustu různých vysokoúrovňových syntéz pro popis digitálních obvodů. Ty nejznámější pak generují VHDL kód z programovacích jazyků jako jsou např.: ANSI C, C++, SystemC, SystemVerilog a MATLAB. Ale ne každý se ztotožní s programováním toho typu, proto je občas dobré přejít na vyšší úroveň abstrakce, kdy se schová vnitřní část komponentů, a pak se dané komponenty volají se vstupy a výstupy. Tato práce se zabývá problematikou návrhu HLS, návrhem vstupního pseudokódu, pseudoknihoven, překladače vytvořeném v jazyce Python, jeho moduly a praktickým použitím. | cs |
dc.description.abstract | Nowadays, there are many different high-level syntheses for describing digital circuits. The best known ones generate VHDL code from programming languages such as ANSI C, C++, SystemC, SystemVerilog and MATLAB. But not everyone will identify with that type of programming, so sometimes it's good to go to a higher level of abstraction, where the internals of the components are hidden, and then the components are called with inputs and outputs. This thesis deals with the design of HLS, the design of input pseudocode, pseudo-libraries, compiler created in Python, its modules and practical application. | en |
dc.description.mark | C | cs |
dc.identifier.citation | PASTUŠEK, V. Prostředí pro návrh digitálních obvodů s využitím vlastního jazyka typu HLS [online]. Brno: Vysoké učení technické v Brně. Fakulta elektrotechniky a komunikačních technologií. 2022. | cs |
dc.identifier.other | 141513 | cs |
dc.identifier.uri | http://hdl.handle.net/11012/205563 | |
dc.language.iso | cs | cs |
dc.publisher | Vysoké učení technické v Brně. Fakulta elektrotechniky a komunikačních technologií | cs |
dc.rights | Standardní licenční smlouva - přístup k plnému textu bez omezení | cs |
dc.subject | VHDL | cs |
dc.subject | HLS | cs |
dc.subject | MyHDL | cs |
dc.subject | FPGA | cs |
dc.subject | vysokoúrovňová syntéza | cs |
dc.subject | překladač | cs |
dc.subject | pseudokód | cs |
dc.subject | Python | cs |
dc.subject | VHDL | en |
dc.subject | HLS | en |
dc.subject | MyHDL | en |
dc.subject | FPGA | en |
dc.subject | high-level synthesis | en |
dc.subject | compiler | en |
dc.subject | pseudocode | en |
dc.subject | Python | en |
dc.title | Prostředí pro návrh digitálních obvodů s využitím vlastního jazyka typu HLS | cs |
dc.title.alternative | HLS development tool for DSP with custom programming language | en |
dc.type | Text | cs |
dc.type.driver | bachelorThesis | en |
dc.type.evskp | bakalářská práce | cs |
dcterms.dateAccepted | 2022-06-14 | cs |
dcterms.modified | 2022-06-14-12:37:34 | cs |
eprints.affiliatedInstitution.faculty | Fakulta elektrotechniky a komunikačních technologií | cs |
sync.item.dbid | 141513 | en |
sync.item.dbtype | ZP | en |
sync.item.insts | 2022.06.15 09:54:33 | en |
sync.item.modts | 2022.06.15 08:16:12 | en |
thesis.discipline | bez specializace | cs |
thesis.grantor | Vysoké učení technické v Brně. Fakulta elektrotechniky a komunikačních technologií. Ústav radioelektroniky | cs |
thesis.level | Bakalářský | cs |
thesis.name | Bc. | cs |
Files
Original bundle
1 - 3 of 3
Loading...
- Name:
- final-thesis.pdf
- Size:
- 3.61 MB
- Format:
- Adobe Portable Document Format
- Description:
- final-thesis.pdf
Loading...
- Name:
- review_141513.html
- Size:
- 7.14 KB
- Format:
- Hypertext Markup Language
- Description:
- review_141513.html